Nuevo USB lógica 100 MHz 16Ch analizador lógico para el brazo FPGA E4-004

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Analizador lógico USB 100 MHz 16Ch para brazo FPGA

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Descripción:
1 El uso de adquisición en tiempo real USB2.0 de alta velocidad, interfaz para subir a PCImplementa la gestión de almacenamiento de datos en tiempo real y se recopila después del final de la pantalla.
2, usando la memoria del ordenador como memoria de adquisición, para que puedas utilizar el analizador lógico tradicionalLa profundidad de la memoria no se puede comparar fácilmente alcanza la profundidad de almacenamiento del nivel G.
3, ver acuerdo anterior es un análisis en tiempo real en línea, puedes ver los detalles del tiempo,¿La conducta del DEBUG? También puedes ver el contenido de las comunicaciones desde la macro para guardarEl contenido del acuerdo para resolver la salida a un archivo de texto y archivos de hojas de cálculo. La siguienteLa figura muestra la I2C protocolo para analizar la salida de texto archivo TXT y de hoja de cálculo archivos
4, el poder del software es el análisis del Protocolo. Admite más de 10 tipos de protocolo en serie.Las formas de onda se pueden adquirir de acuerdo con las normas del Protocolo de busEl contenido de la pantalla, para que puedas ver el mismo error. Muy intuitivo, usado una vez, para garantizarLo pones abajo, separándote de la forma de onda. Especialmente los que se dedican al autobús FPGAModelo de Protocolo de interfaz para lograr casi más conveniente que antes de la simulación.
5, se puede configurar de forma flexible la tasa de muestreo y el número de canales de adquisición, tiempo de adquisición de 3 víasPara lograr una tasa de muestreo máxima de 100 M, 6 veces para lograr una tasa de muestreo de 50 M, tasa de muestreoPara lograr el más alto 32 MHZ 9, 16, cuando obtuvo una tasa de muestreo máxima de 16 M.
6, tamaño pequeño, fácil de llevar, uso de energía USB, fácil puesta en marcha.
Incluyendo SPI, UART, lata, JTAG, 1 cable como soporte para hasta 17 tipos de protocolo serie
Análisis de Cubre casi todos los tableros de serie comunes y el Protocolo de bus de nivel de campo.

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